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《Verilog HDL 程序设计教程》2

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资 源 简 介

《Verilog HDL 程序设计教程》2-"Verilog HDL Design Guide," 2

文 件 列 表

chap5
adder.v
adder16.v
alu.v
block.v
buried_ff.v
compile.v
count.v
count60.v
decode4_7.v
loop1.v
loop2.v
loop3.v
mult_for.v
mult_repeat.v
mux21_1.v
mux21_2.v
mux4_1.v
mux_casez.v
non_block.v
test.v
voter7.v
wave1.v
wave2.v

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