Verilog module containing a synthesizable CRC function
//* polynomial: (0 1 8)...
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标 签：
VHDL
vhdl
资 源 简 介
Verilog module containing a synthesizable CRC function
// * polynomial: (0 1 8)
// * data width: 8-Verilog module containing a synthesizable CRC function
//* polynomial: (0 1 8)
//* data width: 8
