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CPLD

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  • 上传时间:2021-06-30
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  • 标      签: MiddleWare vhdl

资 源 简 介

基于CPLD的计数器 实现光纤测距,包含与单片机的时序控制 Verilog 实现 通过仿真-CPLD-based counters realize optical ranging, single-chip microcomputer that contains timing control and realize the adoption of Verilog simulation

文 件 列 表

counter
db
counter.qpf
counter.qsf
counter.qws

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