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用verilogHDL写的一个risc处理器

资 源 简 介

用verilogHDL写的一个risc处理器-VerilogHDL write with a RISC processor

文 件 列 表

compu1
_xmsgs
_ngo
xst
isim
RISC_SPM_vhdl.prj
isim.log
compu.ntrc_log
Control_Unit.v
RISC_SPM.ngr
RISC_SPM.ngc
RISC_SPM.stx
compu.ise_ISE_Backup
RISC_SPM.bld
RISC_SPM.ngd
RISC_SPM_prev_built.ngd
RISC_SPM_map.mrp
RISC_SPM_map.ngm
RISC_SPM.v
RISC_SPM_summary.html
Processing_Unit.v
Memory_Unit.vhd
Memory_Unit.v
Register_Unit.v
D_flop.v
Address_Register.v
Instruction_Register.v
Program_Counter.v
Multiplexer_5ch.v
Multiplexer_3ch.v
Alu_RISC.v
RISC_SPM.prj
RISC_SPM.xst
RISC_SPM.cmd_log
RISC_SPM.syr
RISC_SPM.lso
isimwavedata.xwv
isim.hdlsourcefiles
compu.ise
.lso
RISC_SPM_map.ncd
RISC_SPM_usage.xml
RISC_SPM.par
RISC_SPM.ncd
RISC_SPM.xpi
RISC_SPM_pad.csv
RISC_SPM.pad
RISC_SPM_pad.txt
RISC_SPM.unroutes
risc_spm.twx
risc_spm.twr
risc_spm.bgn
risc_spm.drc
risc_spm.bit
_impact.log
_impact.cmd
xilinxsim.ini
testbench_isim_beh.exe
testbench.v
testbench_v_beh.prj
isim.cmd
testbench_v_isim_beh.exe
RISC_SPM.ucf
RISC_SPM.lfp
RISC_SPM.pcf
RISC_SPM.ut
device_usage_statistics.html
RISC_SPM.cel
test_RISC_SPM.v
testbench_beh.prj
RISC_SPM_last_par.ncd
isim.tmp_save
_1
isim.tmp_save

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