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verilog的111个经典实例

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  • 标      签: 算法 verilog 实例 经典

资 源 简 介

Verilog HDL是一种硬件描述语言,用于从算法级、结构级、门级到开关级的多种抽象设计层次的数字系统建模。 被建模的数字系统对象的复杂性可以介于开关级电路(例如pmos/nmos)、简单的门(例如库单元描述)和完整的复杂电子数字系统之间(例如CPU)

文 件 列 表

Verilog的135个经典设计实例.txt

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