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基于FPGA的数字频率计设计

  • 资源大小:2.61 MB
  • 上传时间:2021-06-30
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  • 标      签: VHDL

资 源 简 介

使用飓风开发板,完成了100M,频率计设计,并可在数码管显示

文 件 列 表

2016电子设计竞赛基于FPGA的数字频率计设计报告.docx
all
2016EDM.bdf
2016EDM.qpf
2016EDM.qsf
2016EDM.qws
CHOICE.bsf
CHOICE.vhd
CHOICE.vhd.bak
CNT10.bsf
CNT10.vhd
CNT8.bdf
CNT8.bsf
CONTROLS.bsf
CONTROLS.vhd
db
decl7s.bsf
decl7s.vhd
greybox_tmp
incremental_db
int_div.bsf
int_div.vhd
LATCH48.bsf
LATCH48.vhd
LATCH48.vhd.bak
output_files
PLL.bsf
PLL.cmp
PLL.ppf
PLL.qip
PLL.vhd
PLLJ_PLLSPE_INFO.txt
SELE.bsf
SELE.vhd
SELE.vhd.bak
流程图.vsdx

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