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pwm virterbi 译码器

  • 资源大小:1.07 MB
  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog 译码器 pwmvirterbi

资 源 简 介

维特比译码器使用维特比译码算法采用卷积码进行编码的比特流解码。还有其他算法译码卷积编码的流 (例如,Fano 算法)。维特比译码算法是最耗费资源的但它的最大似然解码。这最常用的约束长度 k 的卷积码译码 < = 10,但值 k = 15 都在实践中使用。由安德鲁 J 制定并发表论文汇刊信息理论、 IT-13 卷,第 260-269 页"错误边界为卷积码和渐近最优解码算法",在 1967 年 4 月,维特比译码。

文 件 列 表

test_pwm
_xmsgs
_ngo
xst
xlnx_auto_0_xdb
isim
iseconfig
ipcore_dir
frquency_divider_by10.bgn
frquency_divider_by10.bld
frquency_divider_by10.cmd_log
frquency_divider_by10.lso
frquency_divider_by10.ncd
frquency_divider_by10.ngc
frquency_divider_by10.ngd
frquency_divider_by10.ngr
frquency_divider_by10.pad
frquency_divider_by10.par
frquency_divider_by10.pcf
frquency_divider_by10.prj
frquency_divider_by10.ptwx
frquency_divider_by10.stx
frquency_divider_by10.syr
frquency_divider_by10.twr
frquency_divider_by10.twx
frquency_divider_by10.unroutes
frquency_divider_by10.ut
frquency_divider_by10.xpi
frquency_divider_by10.xst
frquency_divider_by10_envsettings.html
frquency_divider_by10_guide.ncd
frquency_divider_by10_map.map
frquency_divider_by10_map.mrp
frquency_divider_by10_map.ncd
frquency_divider_by10_map.ngm
frquency_divider_by10_map.xrpt
frquency_divider_by10_ngdbuild.xrpt
frquency_divider_by10_pad.csv
frquency_divider_by10_pad.txt
frquency_divider_by10_par.xrpt
frquency_divider_by10_summary.html
frquency_divider_by10_summary.xml
frquency_divider_by10_usage.xml
frquency_divider_by10_xst.xrpt
fuse.log
fuse.xmsgs
fuseRelaunch.cmd
generator.v
generatory.cmd_log
generatory.lso
generatory.ngc
generatory.ngr
generatory.prj
generatory.stx
generatory.syr
generatory.xst
generatory_envsettings.html
generatory_summary.html
generatory_xst.xrpt
isim.cmd
isim.log
par_usage_statistics.html
pw1.v
pwm.v
pwm_summary.html
tb_pw1.v
test2.v
test2_summary.html
test_pwm.gise
test_pwm.xise
top_tb_beh.prj
top_tb_isim_beh.exe
top_tb_isim_beh.wdb
top_tb_stx_beh.prj
tv_tb.v
tv_tb_isim_beh.exe
webtalk_pn.xml
xilinxsim.ini

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