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Cache verilog代码

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  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog 代码 Cacheverilog

资 源 简 介

应用背景原创VERILOG HDL 实现数据指令CACHE的操作,LRU替换算法,包括1路组相连和2路组相连,包含ISE工程文件,亲测可用,初学者必备关键技术采用verilog语言设计的ARM cache,包含tb文件,写回策略。LRU替换算法

文 件 列 表

arm_cache_sort
D_Cache.v
ISE工程.rar
I_Cache.v
program.mif
srandom.c
_main.s

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