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verilog七段数码管

  • 资源大小:4.34 MB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

基于xilinx公司的basys3做的项目,利用一个拨码开关控制,开关状态分别正序倒序显示1234

文 件 列 表

project_1
.Xil
project_1.cache
project_1.hw
project_1.ioplanning
project_1.ip_user_files
project_1.runs
project_1.sim
project_1.srcs
project_1.xpr
synth_1.csv
synth_1.xdc
vivado.jou
vivado.log
vivado_10716.backup.jou
vivado_10716.backup.log
vivado_12172.backup.jou
vivado_12172.backup.log
vivado_13272.backup.jou
vivado_13272.backup.log
vivado_1416.backup.jou
vivado_1416.backup.log

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