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7x7块交织器的FPGA设计

  • 资源大小:1.22 MB
  • 上传时间:2021-06-30
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  • 标      签: VHDL fpga 设计 交织

资 源 简 介

基于FPGA的7x7块交织器设计,程序分交织、解交织两部分,并在QUARTUS II 9.0 下仿真通过,内附模块详细端口说明及仿真分析文件。

文 件 列 表

7乘7块交织器
Interweave
De_Interweave
readme.doc

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