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16位处理器

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  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog 位处 理器

资 源 简 介

应用背景创建一个新的Quartus II工程将用于在Altera DE2的电路实现—系列板。这个项目应该包含一个包含适当的输入和输出的顶级模块在Altera板端口。实例化你的处理器在顶层模块。使用开关sw15−0驱动该处理器使用开关SW17驱动运行输入DIN输入端口。同时,利用按键KEY0在时钟resetn和KEY1。将处理器总线导线ledr15−0和连接完成信号以LEDR关键技术该项目可用于8位处理器验证。你可以设计你自己的8位处理器,它通过验证代码。该代码用于verilog平台

文 件 列 表

16 BIT PROCESSOR
bit_16_mult
BIT_16_PROCESSOR
bit_1_mult
booth_test
cpu
testadder_sub
test_processor_16

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