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SDRAM控制器设计代码

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  • 上传时间:2021-06-30
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  • 标      签: VHDL

资 源 简 介

SDRAM控制器设计代码,我们写的SDRAM控制器是肯定包括初始化、读操作、写操作及自动刷新这些操作的,既然这样,我们就可以给每一个操作写上一个模块独立开来,这样也便于我们每个模块的调试,显然这种思路是正确的。那怎么让我们的各个模块工作起来呢,虽然都是独立的模块,但很显然这几个模块之间又是相互关联的。就拿上面刚才说的那个情况来讲,如果SDRAM需要刷新了,而SDRAM却正在执行写操作,那我们刷新模块与写模块之间怎么进行控制呢?这个问题解决了,读模块与刷新模块之间的这个问题也可以很轻松的解决。

文 件 列 表

SDRAM_CONTROLER_Modelsim
实战训练13 SDRAM读写控制的实现与Modelsim仿真
使用Verilog实现基于FPGA的SDRAM控制器.doc

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