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并行LMS均衡FPGA实现

  • 资源大小:4.57 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

实现FPGA的并行LMS均衡,主要是均衡计算权值系数的算法过程,verilog语言,模块的输入为输入的X信号,输出为权值系数W,以及最后的输出Y。实现了LMS 的并行均衡过程

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