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verilog

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  • 上传时间:2021-06-30
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  • 标      签: 其他项目 vhdl

资 源 简 介

verilog-wire a simple circuits

文 件 列 表

test1
db
test1.asm.rpt
test1.done
test1.fit.rpt
test1.fit.smsg
test1.fit.summary
test1.flow.rpt
test1.map.rpt
test1.map.smsg
test1.map.summary
test1.pin
test1.pof
test1.qpf
test1.qsf
test1.qsf.dkp
test1.qws
test1.sof
test1.tan.rpt
test1.tan.summary
test1.v
test1.v.bak

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