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16bit multiplier

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  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

Verilog code to implment the 16 bits logic multiplier. The output is also 16bits including the document to describe the implement in detail .

文 件 列 表

16bits_multiplier
adder_32.v
compressor.v
mul_booth2.v
tb.v
乘法器设计报告.doc

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