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AMBA总线的Verilog语言模型

  • 资源大小:16.57 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

AMBA总线的Verilog语言模型 包括:AHB总线仲裁器,AHB-APB总线桥接器,AHB总线上从设备ROM模型,AHB总线上从设备RAM模型,参数定义。

文 件 列 表

defines
ahb_defines.v
apb_defines.v
ahb_sram_slave
rtl
ahb_rom_slave
rtl
ahb_arbiter
rtl
ahb_apb_bridge
rtl

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