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数码管时钟

  • 资源大小:2.21 MB
  • 上传时间:2021-06-30
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  • 标      签: VHDL vhdl 时钟 数码管

资 源 简 介

利用8段数码管实现的秒表时钟,FPGA使用EP2C80208C8N,通过例化数码管控制模块、秒表计时模块、时钟进位模块等实现准确计时。

文 件 列 表

Clock
incremental_db
db
Clock.asm.rpt
Clock.done
Clock.fit.rpt
Clock.fit.smsg
Clock.fit.summary
Clock.flow.rpt
Clock.jdi
Clock.map.rpt
Clock.map.summary
Clock.pin
Clock.pof
Clock.qpf
Clock.qsf
Clock.qws
Clock.sdc
Clock.sof
Clock.tan.rpt
Clock.tan.summary
Clock.vhd
Clock.vhd.bak
EP2C8Q208.tcl
Second.vhd
Second.vhd.bak
Segment.vhd
Segment.vhd.bak
SignalTab.stp

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