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基于FPGA的六路抢答器

  • 资源大小:1.35 MB
  • 上传时间:2021-06-30
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  • 标      签: VHDL

资 源 简 介

设计一个可供6组参赛选手使用的抢答器,具体要求如下:1)  可容纳6组参赛者的数字智能抢答器,每组设置一个抢答按钮供抢答者使用;2)  电路具有第一抢答信号的鉴别和锁存功能;3)  设置计分电路4)  设置犯规电路。顶层设计使用图形模块连线搭建,顶层功能模快均使用VHDL语言编写

文 件 列 表

源代码+截图
CLKGEN
HBF
LOCK
REG2B
RES
RES顶层仿真结果.jpg
RES顶层电路图.jpg
TCLK
Thumbs.db
res.acf
res.hif
渐变LED灯仿真图.jpg

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