vivado2017+下的HDMI环路视频代码（AX7103）
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标 签：
Verilog
资 源 简 介
在黑金AX7103板子上（A7）实现的demo工程中，存在一些bug。给与修正
文 件 列 表
hdmi_loop
.Xil
hdmi_loop.cache
hdmi_loop.hw
hdmi_loop.ip_user_files
hdmi_loop.runs
hdmi_loop.sim
hdmi_loop.srcs
hdmi_loop.xpr
ip_upgrade.log
vivado.jou
vivado.log
