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BGM benchmark

资源大小：14.66 kB
上传时间：2021-06-30
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标签： Verilog

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// DEFINES `define BITS 32 // Bit width of the operands `define NumPath 34 module bgm(clock, reset, sigma_a, sigma_b, sigma_c, Fn, dw_x, dw_y, dw_z, dt, Fn_out ); // SIGNAL DECLARATIONS input clock; input reset; input [`BITS-1:0] sigma_a; input [`BITS-1:0] sigma_b; input [`BITS-1:0] sigma_c; input [`BITS-1:0] Fn; input [`BITS-1:0] dw_x; input [`BITS-1:0] dw_y; input [`BITS-1:0] dw_z; input [`BITS-1:0] dt;

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