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USB1.1 IP核心控制设备,用硬件描述语言…

  • 资源大小:128.67 kB
  • 上传时间:2021-06-30
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  • 标      签: VHDL others

资 源 简 介

usb1.1的设备控制器IP核,是用verilog硬件描述语言写的-USB1.1 IP core for device control, written with hardware describing language of Verilog.

文 件 列 表

usb1.1
test_bench
tests_lib.v
test_bench
generic_memories
generic_dpram.v
generic_memories
generic_fifos
generic_fifos.tar.gz
generic_fifos
The USB 1.1 Function IP Core.txt
rtl
usb1_core.v
rtl
phy_utmi
readme.txt
phy_utmi
test_bench
tests.v
usb1.1

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