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Median Filter

  • 资源大小:58.47 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog MedianFilter

资 源 简 介

基于FPGA开发3*3模板的Median Filter,均值滤波器的缺点是,会使图像变的模糊,原因是它对所有的点都是同等对待,在将噪 声点分摊的同时,将景物的边界点也分摊了。为了改善效果,就可采用加权平均的方式来构造滤波器。

文 件 列 表

Code_for_MedianFilter33
comparator_mdf.v
data_gen.v
drf1024x16.v
drf896x16.v
dsram1920x16.v
edge_detect.v
line_buffers_mdf.v
MedianFilter
median_filter.v
rd_ctr_mdf.v
top_median_filter.v
transcript
wr_ctr_mdf.v
www.pudn.com.txt
yuv_data_out.v

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