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A Microchip PIC-Compatible RISC CPU IP Core Design and Verilog Implementation

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  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

A Microchip PIC-Compatible RISC CPU IP Core Design and Verilog Implementation 含Verilog源代码以及设计文档 本文件夹里面的是实现pic10 CPU的全部verilog代码以及相应的测试脚本代码,当然有一些模块是在quartus中直接编辑波形测试的,所以没有响应的测试脚本文件。 tri_state_port的测试还未完成,test_pic10_status_reg.vt和test_pic10_tri_state_port2.vt都没有完成测试任务 其中有三篇文档: PIC10_RISC_Design.pdf:原文(verilog代码基本都来自原文,对一部分进行了改进),这篇文章写得非常好 PIC10F200_单片机IP核的实现.pdf:对上面的文章结合自己的实验过程进行了翻译和改写,给大家参考 PIC10F:PIC10系列单片机的手册

文 件 列 表

controller.v
program_store.v
datapath_testbenches.v
datapath.v
cpu_testbench.v
cpu.v

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