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FPGA实现数字频率计

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  • 上传时间:2021-06-30
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  • 标      签: FPGA

资 源 简 介

通过Verilog HDL语言编程实现数字频率计的设计,通过加按键和减按键来实现8个不同频率的切换,并通过相应的LED小灯展现出来,实现现象为频率不同LED灯的闪烁频率也不同。注:此程序基于系统时钟为10MHZ的实验平台,所选的芯片为FLEX10K:EPF10K10TC144-4,所用软件为QuartusII9.0.

文 件 列 表

数字分频计-终结版
incremental_db
db
Div_x.asm.rpt
Div_x.done
Div_x.dpf
Div_x.fit.rpt
Div_x.fit.summary
Div_x.flow.rpt
Div_x.map.rpt
Div_x.map.smsg
Div_x.map.summary
Div_x.pin
Div_x.pof
Div_x.qpf
Div_x.qsf
Div_x.qws
Div_x.sof
Div_x.tan.rpt
Div_x.tan.summary
Div_x.v
Div_x.v.bak
Div_x_assignment_defaults.qdf

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