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CSA - carry select Adder (16 bit by verilog)

  • 资源大小:1.56 MB
  • 上传时间:2021-06-30
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  • 资源积分:1积分
  • 标      签: 算法 verilog

资 源 简 介

这是verilog提供的16位CSA

文 件 列 表

2
CSA2
CSA2
CRA2.v
CRA2.v.bak
CSA2.cr.mti
CSA2.mpf
CSA_16.v
CSA_16.v.bak
MUX.v
MUX.v.bak
testbench_adder.v
top_adder.v
vsim.wlf
4
CSA4
CSA4
CRA4.v
CSA_16.cr.mti
CSA_16.mpf
CSA_16.v
CSA_16.v.bak
MUX.v
testbench_adder.v
top_adder.v
vsim.wlf
8
before synthesis
CSA area.JPG
CSA path(0).JPG
CSA path(1).JPG
CSA simul.JPG
CSA timing.JPG
post-sythesis
csa.cr.mti
before synthesis
CRA4.v.bak
CSA.cr.mti
CSA.mpf
CSA8.v
CSA8.v.bak
CSA_16.v
CSA_16.v.bak
MUX.v
MUX.v.bak
testbench_adder.v
top_adder.v
vsim.wlf

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