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多周期CPU设计包括basys3板的设计

  • 资源大小:14.45 MB
  • 上传时间:2021-06-30
  • 下载次数:0次
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  • 资源积分:1积分
  • 标      签: Verilog

资 源 简 介

都是实验课作业,直接打包的文件,下载之后可以直接跑。

文 件 列 表

basys3
basys3.cache
basys3.hw
basys3.runs
basys3.sim
basys3.srcs
basys3.xpr
vivado.jou
vivado.log
vivado_4160.backup.jou
vivado_4160.backup.log
vivado_8784.backup.jou
vivado_8784.backup.log
Multiple-CPU
.Xil
data
Multiple-CPU.cache
Multiple-CPU.hw
Multiple-CPU.ip_user_files
Multiple-CPU.runs
Multiple-CPU.sim
Multiple-CPU.srcs
Multiple-CPU.xpr
vivado.jou
vivado.log
vivado_2600.backup.jou
vivado_2600.backup.log
vivado_4876.backup.jou
vivado_4876.backup.log
vivado_pid4876.str

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