8 bit general purpose microprocessor verilog code
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标 签：
VHDL
资 源 简 介
它是一种以地址总线数据总线为结构的8位微处理器，主要由两部分组成：一是控制单元，数据通路控制单元控制微处理器的所有块、寄存器和部件，数据通路由地址和数据通路信号处理组成指令读写加法；
文 件 列 表
microprocessor
_tempmsg
_temp
MICROCONTROLLER
@_opt2
@_opt1
@_opt
_vmake
_info
accumulator.v
accumulator.v.bak
controlunit.v
controlunit.v.bak
datapath.v
datapath.v.bak
decrement unit.v
instrn increment.v
instrn increment.v.bak
instruction register.v
microprocessor.v
microprocessor.v.bak
mux_2x1_8b.v
mux_2x1_8b.v.bak
pc mux.v
pc mux.v.bak
program counter.v
program counter.v.bak
rom.v
rom.v.bak
_lib.qdb
_lib1_2.qdb
_lib1_2.qpg
_lib1_2.qtl
