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mips cpu 五级流水 cache forward

资 源 简 介

这份veirlog的cpu代码,实现了五级流水,cache,冒险处理,其中冒险处理使用预测,实现了分支指令,解决了控制冒险

文 件 列 表

LFYY_cpu
alu.v
EX_stage.v
forward.v
hazard_detection_unit.v
ID_stage.v
IF_stage.v
LFYY_cpu.v
LFYY_cpu_defs.v
MEM_stage.v
register_file.v
testbench.v
WB_stage.v

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