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Verilog 贪吃蛇

  • 资源大小:905.13 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

对于重点:蛇身控制算法,我开始的想法是将每个格子的坐标输入到存储器中,但由于过于繁琐和笨拙,我改为:保留头部的完整数据(位置、方向),其他部分只保留方向数据,并在VGA模块里面直接对蛇身进行控制,但是这个方案有一个弊端:它按照蛇身顺序刷新图像,每一帧图像只能刷新一个格子,时序存在问题并且刷新频率过慢,放弃了这个方案。 最终,将蛇身模块单独提出,各个模块协同工作,有效解决了时序问题和刷新问题。蛇身控制上,只控制蛇头,其他部位随头联动,完成了最终设计。

文 件 列 表

SecretLock2_vrlV0.2
SecretLock2_vrlV0.1
fuse.log
SecretLock2_vrlV0.1
SecretLock2_vrlV0.1
1111.wcfg
SecretLock2_vrlV0.2

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