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简易数字信号分析仪(眼图)

  • 资源大小:5.77 MB
  • 上传时间:2021-06-30
  • 下载次数:0次
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  • 标      签: VHDL

资 源 简 介

采用VHDL语言编写,此题为全国大学生电子设计竞赛题目,产生一个伪随机信号,并用时钟提取模块提取时钟,最终能在示波器上获得眼图,验证实验结果。此程序已经经过本人亲自验证,完全可用,可用于电赛培训之中。

文 件 列 表

m_xulie
db
fre_div.vhd
fre_div.vhd.bak
incremental_db
key.vhd
key.vhd.bak
m_series.qpf
m_series.qsf
m_series.qws
m_series.vhd
m_series_nativelink_simulation.rpt
m_sys.vhd
m_sys.vhd.bak
output_files
re_clk.vhd
re_clk.vhd.bak
simulation

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