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verification environment to verify synchronous FIFO

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  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog

资 源 简 介

-&同步FIFO的验证环境。

文 件 列 表

uvm_FIFO
1synfifo.sv
asse.sv
comp_seq.sv
intf.sv
read_empty_seq.sv
reset_seq.sv
script.sh
sfagent.sv
sfdriver.sv
sfenvironment.sv
sfmonitor.sv
sfscoreboard.sv
sfsequencer.sv
sftest.sv
strans.sv
synfifo.sv
top.sv
write_full_seq.sv

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