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selfmade UART HDL code

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  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog

资 源 简 介

用veriloghdl编写的自制UART。在modelsim下

文 件 列 表

HDL code
head_uart.v
rxd.v
testbench.v
transcript
txd.v
uart.v
utils.v

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