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ddr3 sdram 控制器代码,verilog

  • 资源大小:60.46 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

根据DDR3的特点和操作原理,利用MIG软件工具在Virtex-6系列FPGA中实现DDR3SDRAM控制器的设计,并给出了硬件测试的结果,代码为verilog,通过仲裁机制完成设计,希望对学习fpga的人有帮助

文 件 列 表

1024Mb_ddr3_parameters.vh
2048Mb_ddr3_parameters.vh
4096Mb_ddr3_parameters.vh
ddr3.v
ddr3_mcp.v
ddr3_module.v
mem_init.txt
readme.txt
subtest.vh
tb.v

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