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眼电图形刺激器设计

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  • 上传时间:2021-06-30
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  • 标      签: VHDL vhdl 设计 图形

资 源 简 介

完成黑白全屏半屏棋盘格、红绿全屏半屏竖条栅、蓝绿全屏半屏横条栅六种图形格式之间的循环转换,用FPGA实现VGA显示。 设计方案的顶层文件需有几个模块构成:锁相环模块,分频定时模块,时序控制模块和显示模块。每个模块首先用VHDL语言 完成实现并仿真,再生成模块放在顶层的block文件中。锁相环模块作用是把硬件实验板的50MHz转换为适用于VGA800*600 的40MHz时钟;定时模块定时5秒,每5秒转换一种图形显示方式;时序控制模块用于扫描及消隐,使能够正常显示;显示模块 用于显示。各模块正确连线、定义引脚和仿真后,可以下载到FPGA中,连接显示器来显示,六种图形方案每5秒转换,循环。

文 件 列 表

luojie-(再修好的)
db
fen.cmp
fen.ppf
fen.vhd
fenpin.bsf
fenpin.inc
fenpin.vhd
fenpin.vhd.bak
fen_wave0.jpg
fen_waveforms.html
gao.bsf
gao.vhd
gao.vhd.bak
incremental_db
luojie.asm.rpt
luojie.bdf
luojie.cdf
luojie.done
luojie.dpf
luojie.fit.rpt
luojie.fit.smsg
luojie.fit.summary
luojie.flow.rpt
luojie.map.rpt
luojie.map.summary
luojie.pin
luojie.pof
luojie.qpf
luojie.qsf
luojie.qws
luojie.sim.rpt
luojie.sof
luojie.tan.rpt
luojie.tan.summary
luojie.vwf
luojie_assignment_defaults.qdf
pll.bsf
pll.cmp
pll.ppf
pll.vhd
pll_wave0.jpg
pll_waveforms.html
vga800600.bsf
vga800600.vhd
vga800600.vhd.bak

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