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10进制的FPGA数字计数器

  • 资源大小:9.16 MB
  • 上传时间:2021-06-30
  • 下载次数:0次
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  • 资源积分:1积分
  • 标      签: Verilog verilog

资 源 简 介

本程序可以在DE1-SOC的实现10进制的FPGA数字计数器

文 件 列 表

counter10
simulation
output_files
incremental_db
hc_output
db
c5_pin_model_dump.txt
counter10.qpf
counter10.qsf
counter10.qws
counter10.v

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