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有限状态机 — FSM

  • 资源大小:775.40 kB
  • 上传时间:2021-06-30
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  • 标      签: VHDL vhdl fsm 有限 状态

资 源 简 介

有限状态机是指输出取决于过去输入部分和当前输入部分是时序逻辑电路。在有限状态机中,状态寄存器的下一个状态不仅与输入信号有关,而且还与该寄存器的当前输入有关,因此有限状态机又可以认为是组合逻辑和寄存器逻辑的一中组合。下面代码是哈工大计算机学院CPU设计中关于有限状态机部分的代码。

文 件 列 表

FSM1
_xmsgs
_ngo
xst
work
FSM1_html
transcript
FSM1.bld
FSM1.cmd_log
FSM1.gyd
FSM1.ise
FSM1.ise_ISE_Backup
FSM1.jed
FSM1.lso
FSM1.mfd
FSM1.nga
FSM1.ngc
FSM1.ngd
FSM1.ngr
FSM1.pad
FSM1.pnx
FSM1.prj
FSM1.rpt
FSM1.stx
FSM1.syr
FSM1.tim
FSM1.tspec
FSM1.vhd
FSM1.vm6
FSM1.xml
FSM1.xst
FSM1_build.xml
FSM1_pad.csv
FSM1_vhdl.prj
pepExtractor.prj
results.txt
tmperr.err
vsim.wlf
wave.ant
wave.fdo
wave.jhd
wave.tbw
wave.udo
wave.vhw
wave.xwv
wave.xwv_bak
wave_bencher.prj

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