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DDS 正弦波发生器

  • 资源大小:3.79 MB
  • 上传时间:2021-06-30
  • 下载次数:0次
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  • 资源积分:1积分
  • 标      签: Verilog verilog dds 发生器 正弦

资 源 简 介

基于DDS的正弦波信号发生器,Quartus工程,输出频率根据clk确定,一个周期内采样256个点,输出精度为8位,未添加滤波器模块

文 件 列 表

DDS
cnt.v
cnt.v.bak
db
greybox_tmp
incremental_db
myfile
output_files
simulate
sine_rom.mif
sine_rom.qip
sine_rom.v
sine_rom_bb.v
sine_top.qpf
sine_top.qsf
sine_top.qws
sine_top.v
sine_top.v.bak

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