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异步FIFO

  • 资源大小:1.21 MB
  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog fifo 异步

资 源 简 介

这是一个异步的FIFO模块,还有5个部分,比较器,写满读空状态标志,和一个RAM模块,是编写一些大型程序的基础模块。谢谢大家,期望大家能够用得着

文 件 列 表

yibufifo
async_cmp.v
db
incremental_db
ram.v
rptr_empty2.v
simulation
wptr_full2.v
yibufifo.asm.rpt
yibufifo.done
yibufifo.eda.rpt
yibufifo.fit.rpt
yibufifo.fit.smsg
yibufifo.fit.summary
yibufifo.flow.rpt
yibufifo.map.rpt
yibufifo.map.summary
yibufifo.pin
yibufifo.pof
yibufifo.qpf
yibufifo.qsf
yibufifo.qws
yibufifo.sof
yibufifo.tan.rpt
yibufifo.tan.summary
yibufifo.v
yibufifo_nativelink_simulation.rpt

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