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8 位加法器 verilog

  • 资源大小:681.62 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog

资 源 简 介

嘿,这里是 ise 格式代码为 xilinx 软件 verilog 的 8 位固定点编码使用此编码与测试工作台为例

文 件 列 表

gfulladder
__projnav
_xmsgs
_ngo
xst
work
gadder_html
transcript
.untf
automake.log
fulladd.v
gadddertfr_v.fdo
gadddertfr_v.udo
gadddetfr.v
gadddetfr_v.fdo
gadddetfr_v.tdo
gadddetfr_v.udo
gadder.bld
gadder.chk
gadder.cmd_log
gadder.cxt
gadder.gyd
gadder.ldo
gadder.log
gadder.lso
gadder.mfd
gadder.nga
gadder.ngc
gadder.ngd
gadder.ngr
gadder.pad
gadder.par_nlf
gadder.pnx
gadder.prj
gadder.rpt
gadder.stx
gadder.syr
gadder.tim
gadder.tspec
gadder.v
gadder.versim_par
gadder.vm6
gadder.xml
gadder._hrpt
gaddertf.v
gaddertf_v.fdo
gaddertf_v.tdo
gaddertf_v.udo
gadder_build.xml
gadder_pad.csv
gadder_timesim.nlf
gadder_timesim.sdf
gadder_timesim.v
gadder_vhdl.prj
gfulladder.dhp
gfulladder.ise
gfulladder.ise_ISE_Backup
prjname.lso
Project.dhp
tmperr.err
vsim.wlf
__projnav.log

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