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FPGA 的数字闹钟

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  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog fpga 数字

资 源 简 介

这个项目旨在在 FPGA 上实现数字闹钟的功能。尽快 FPGA 打开时,时钟就开始了。可以使用 FPGA 板上提供 dip 开关设置报警。通过相应的 dip 开关指示灯表明了这一点。计数器保持工作,一旦报警消除,像声音放大通过扬声器蜂鸣器。 该项目是充分的。享受它吧 !

文 件 列 表

FPGA_Alarmclock (1).pdf

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