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SPI verilog 源代码

  • 资源大小:10.38 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog 源代码 SPIverilog

资 源 简 介

串行外设接口或 SPI 总线是一个同步串行数据链接,一个事实上的标准,由摩托罗拉命名,在全双工模式下运行 。它用于短的距离,单掌握沟通的例如在嵌入式的系统、 传感器和 SD 卡。设备在哪里主设备启动数据帧的主从 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报

文 件 列 表

SPIP_ROJECT
packet.sv
spi_m.sv
spi_m_if.sv
spi_m_if.sv~
spi_s.sv
spi_s_if.sv
spi_s_if.sv~
test.sv
testbench_top.sv

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