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sobel 边缘检测

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  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog 检测 sobel 边缘

资 源 简 介

这 VHDL/Verilog 或 C/c + + 源代码并作为设计参考说明了如何实现这些类型的功能。这是用户的责任,来验证其设计的一致性和使用形式化验证方法的功能。

文 件 列 表

p-1.m
p-2.m
p-3.m
p2.m
Prac_10Butter_DIP.m
Prac_10DIP.m
Prac_10DIP_butter_HP.m
prac_10DIP_HIGHPASS.m
Prac_10gaussian_DIP.m
Prac_8min.m

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