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按键边缘检测

  • 资源大小:304.00 kB
  • 上传时间:2021-06-30
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  • 标      签: VHDL verilog 检测 边缘 按键

资 源 简 介

用Verilog编写的基于FPGA的按键边缘检测技术,通过此模块可以很好的消除在按键过程中因抖动或误按造成的 麻烦,同时,在边缘检测技术中使用了约翰逊计数器的思想,是的代码简介,思路清晰。源码中含有大量的注释,有助于读者更好地了解编码思想。

文 件 列 表

keyscanverilog
simulation
db
sw_debounce.asm.rpt
sw_debounce.done
sw_debounce.dpf
sw_debounce.eda.rpt
sw_debounce.fit.rpt
sw_debounce.fit.smsg
sw_debounce.fit.summary
sw_debounce.flow.rpt
sw_debounce.map.rpt
sw_debounce.map.summary
sw_debounce.pin
sw_debounce.pof
sw_debounce.qpf
sw_debounce.qsf
sw_debounce.qws
sw_debounce.sof
sw_debounce.tan.rpt
sw_debounce.tan.summary
sw_debounce.v
sw_debounce.v.bak

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