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DDS线性调频信号发生器(FPGA, VHDL)

  • 资源大小:0.31M
  • 上传时间:2021-09-16
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  • 标      签: 一般编程问题

资 源 简 介

用VHDL编写的 正弦波DDS线调频信号发生器(FPGA)。其中,rom为1/4周期波形,波形起始、终止频率在K_con.vhd模块中的f1、f2常数。步进不仅频率控制字在判断clk上升沿下一行所加的数值。本程序通过QuartusII 9.0调试通过

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