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实现开漏输出的并口

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  • 上传时间:2022-04-14
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  • 标      签: 开漏输出 并口

资 源 简 介

实现开漏输出的并口,支持3.3V或5V,支持FPGA 的PS 配置功能。8位配置数据 自动移位输出,输入时钟24MHz,产生1MHz配置时钟。8位CPU数据总线接口, 11位地址总线。支持IO 的置位清除功能。

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