首页| JavaScript| HTML/CSS| Matlab| PHP| Python| Java| C/C++/VC++| C#| ASP| 其他|
购买积分 购买会员 激活码充值

您现在的位置是:虫虫源码 > 其他 > 用VHDL设计一个4位二进制并行半加器

用VHDL设计一个4位二进制并行半加器

  • 资源大小:2 K
  • 上传时间:2022-08-22
  • 下载次数:0次
  • 浏览次数:1次
  • 资源积分:1积分
  • 标      签: VHDL 二进制 并行 半加器

资 源 简 介

用VHDL设计一个4位二进制并行半加器,要求将被加数、加数和加法运算和用动态扫描的方式共阴数码管一同时显示出

相 关 资 源

您 可 能 感 兴 趣 的

同 类 别 推 荐

VIP VIP
  • 猕猴桃 1天前 成为了本站会员

  • 11 1天前 成为了本站会员

  • 开心快活人 1天前 成为了本站会员

  • 晋财 1天前 成为了本站会员

  • WYG 2天前 成为了本站会员

  • Shine 2天前 成为了本站会员

  • 柳贻 2天前 成为了本站会员

  • hallelujah_HL 2天前 成为了本站会员

  • 焦昱贺 2天前 成为了本站会员

  • Rubin 2天前 成为了本站会员

0.222366s