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fir滤波器

  • 资源大小:3.83 MB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

用matlab中工具fdatool生成一个低通滤波器,将滤波器系数量化。仿真通过,通带2.5兆,截止频率5M。

文 件 列 表

fir
_xmsgs
isim
iseconfig
ipcore_dir
data.txt
datain.mif
data_out.txt
fir.gise
fir.v
fir.xise
fir_beh.prj
fir_stx_beh.prj
fir_summary.html
fir_test.v
fir_test_beh.prj
fir_test_isim_beh.exe
fir_test_isim_beh.wdb
fir_test_isim_beh1.wdb
fir_test_stx_beh.prj
fuse.log
fuse.xmsgs
fuseRelaunch.cmd
isim.cmd
isim.log
j_1.v
j_1tst.v
j_1tst_isim_beh.exe
j_1tst_isim_beh1.wdb
j_1tst_stx_beh.prj
j_1_isim_beh.exe
xilinxsim.ini

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