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verilog编写的一个fir滤波器,

  • 资源大小:18.89 MB
  • 上传时间:2021-06-30
  • 下载次数:0次
  • 浏览次数:1次
  • 资源积分:1积分
  • 标      签: Verilog verilog

资 源 简 介

本代码实现一个fir滤波器,结合matlab对数据进行进行验证,最后用modesim对编写的代码进行仿真,最终用matlab和fpga实现一个功能正常的fir低通滤波器,这里附有源代码,并且用verilog代码编写,具有很大的参考作用对于刚学习fpga的朋友,希望你们能真正的对所学的东西感兴趣,这个是我上传代码的初衷,希望你们学业进步,继续做一个对技术有信心的人才。

文 件 列 表

fir
simulation
sim
output_files
matlab
ipcore
incremental_db
greybox_tmp
db
addr_count.v
addr_count.v.bak
fir.jdi
fir.qpf
fir.qsf
fir.qws
fir.v
fir.v.bak
fir_assignment_defaults.qdf
fir_function.v
fir_function.v.bak
fir_nativelink_simulation.rpt
fir_parallel.v
fir_tb.v
fir_tb.v.bak
funiction.v.bak
mult.qip
mult.v
rom.hex
rom.mif
rom.qip

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