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类MIPS指令集CPU汇编语言调试器设计研究

资 源 简 介

研究内容: 针对类MIPS指令集CPU,设计具有可扩展指令系统的、支持逐行调试、并具有可视化交互界面的集成汇编模拟器,包括: 1.基于FPGA实现类MIPS指令集CPU。 2.至关重要的调试器硬件接口设计。 3. 基于Visual C++ 2010,设计具有指令扩展能力的、具有可视化集成环境的汇编器/调试器。

文 件 列 表

Project
form1
Debug
form1.sdf
form1.sln
form1.suo
项目展示.pptx
视频.wmv
类MIPS指令集CPU汇编语言调试器设计研究(软件部分).docx
类MIPS指令集CPU汇编语言调试器设计研究(硬件部分).pdf

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