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verilog8位浮点数四则运算

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  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

verilog8位浮点数四则运算。其中mantisa为4位,exp位为3位,符号位1位。可以为其他比特数的浮点运算verilog代码作为借鉴。程序包含testbench可以直接运行。

文 件 列 表

ASSIGN_IN.v
Counter.v
EXP.v
FINISH.v
LOAD_A.v
LOAD_B.v
MANTISA.v
NORMALIZE.v
anode4controller.v
anode_driver.v
clk_conv.v
controller.v
datapath.v
decoder.v
top.v
top_tb.v

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